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Verstehe ich das richtig, das während schreiben/lesen einer PCIe SSD, wie zB der Samsung 960pro die mit 4 CPU Lanes angesteuert wird, die Graka nur mehr mit 8 (oder 12) PCIe Lanes betrieben werden kann?
Der Chipsatz muss dann kurzfristig Lanes teilen/abschalten, weil eben nur 16 Lanes vorhanden sind und nicht einfach 4 Lanes hinzugezaubert werden können. Da der Chipsatz per DMI 3.0 angeblich mit CPU Lanes angebunden ist, kann wohl nur geteilt werden?
Nope CPU---> GPU x16 bzw. bei DualGPU 8x/8x
Chipsatz---> via DMI @ 4lanes an die CPU ähnlich wie PCI-E 3.0, dieser selber hat dann einige Lanes für allen anderen kram und anschlüsse
zufinden in jedem Handbuch z.b. bei gigabyte im Mainboard-Handbuch
Nein. Bei LGA1151 Boards hängt der M.2 Slot immer am Chipsatz, nicht der CPU. Nur wenn die M.2 SSD via Adapter in einen x16 Slot gesteckt wird, werden CPU PCIe Lanes genutzt.
Aber wie fast immer wenn jemand nach M.2 fragt: bringt nix für den Aufpreis. Lieber in eine größere SATA SSD investieren.
Es geht mir um eine Wissensfrage, nicht um einen Kauf von HW.
Der Chipsatz ist angeblich mit 4 CPU Lanes angesteuert, die natürlich von der CPU kommen müssen. Heisst das jetzt, die CPU hat in Wirklichkeit 20 Lanes (16+4) oder wird einfach aufgeteilt?
Ergänzung ()
@ Nilson
Ich habe schon eine Menge Bilder dazu gesehen- sie sagen aber nicht aus, mit was der Chipsatz angesteuert wird.
Hier ein paar Beispiele
Ähnlich wenig Fortschritt gibt es bei den Chipsätzen Z270 und H270: Sie sollen den Z170 und den H170 ersetzen, für sehr günstige Mainboards bleibt der H110 aktuell. Der Z270 weist anders als der Z170 eine von 20 auf 24 gestiegene Anzahl von PCIe-3.0-Lanes auf, der H270 kommt verglichen mit dem H170 auf 20 statt 16 davon. Die Verbindung zwischen CPU und PCH ist aber weiterhin auf vier PCIe-3.0-Lanes beschränkt, schon zwei schnelle PCIe-NVMe-SSDs wie Samsungs 960 Pro lasten die DMI-Schnittstelle daher voll aus.
Aufgrund der zusätzlichen PCIe-Lanes der Chipsätze erhöht Intel die High-Speed-I/O-Lanes (HSIO) von 26 auf 30 (Z170) und von 22 auf 30 (H270). Die HSIO-Lanes dienen der Ansteuerung der Sata-6-GBit/s- und USB-Ports, der PCIe-Lanes und des Gigabit-Ethernets. Wer mitgezählt hat, wird feststellen, dass nicht alle Schnittstellen gleichzeitig genutzt werden können. Es obliegt dem jeweiligen Mainboard-Hersteller, welche Funktionen er mit welchen HSIO-Lanes verknüpft. Der Z270 und der H270 sollen eine größere Flexibilität aufweisen.
Die Anzahl der Sata-6-GBit/s- und USB-3.0-Ports ändert sich bei den neuen PCHs nicht, es bleibt bei 6 sowie 10 (Z270) und 8 (H270). USB 3.1 Gen2 wird erst mit der übernächsten Generation nativ unterstützt. Per zusätzlichem Controller von Asmedia klappt das zwar, dafür müssen aber PCIe-Lanes abgezweigt werden. Was die beiden für Kaby Lake gedachten Chipsätze von den Vorgängern weiter unterscheidet, ist der Support für Optane-Produkte.
Möglich ist auch, dass Slots eine von der Bauform abweichende Anbindung der Lanes haben. Oft zu finden ist das etwa bei SLI und Crossfire. Denn obwohl die Slots für die Grafikkarten die Größe von ×16-Slots haben, werden beim Einsatz von zwei Grafikkarten die 16 Lanes auf beide Slots verteilt, falls die Hauptplatine beziehungsweise der darauf verbaute Chipsatz keine 32 Lanes für beide Grafikkarten bereitstellt, was dann nur noch 8 Lanes pro Karte ergibt. Allerdings findet diese Verminderung der Übertragungskapazität nicht nur bei zwei Grafikkarten statt, sondern beispielsweise auch bei Verwendung einer ×16-Grafikkarte und einer ×1-Karte, so dass die Grafikkarte nur mit ×8 läuft.
Ergänzung ()
@HominiLupus
Und woran hängt der Chipsatz? Lt meinen Vorbeitrag doch an CPU Lanes?
Chipsatz und CPU Verbindung bei moderenen Intel CPUs läuft über den DMI. Der DMI hat nur die Bandbreite von 4*PCIe 3.0 (170er und 270er Chipsätze) Lanes weil die Technologie darauf beruht. Das sind keine PCIe Lanes die man beliebig verwenden kann.
Die Verbindung zwischen CPU und PCH ist aber weiterhin auf vier PCIe-3.0-Lanes beschränkt, schon zwei schnelle PCIe-NVMe-SSDs wie Samsungs 960 Pro lasten die DMI-Schnittstelle daher voll aus.
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Irgendwie scheint sich da einiges zu widersprechen.Bzw gäbe es dann 16+4 Cpu Lanes?
Da widerspricht sich gar nichts, die DMI-Verbindung verwendet 4 separate PCIe-3.0-Lanes die nur dafür verwendbar sind, das hat mit den 16 anderen Lanes der CPU nicht zu tun.
Der PCH hat separate PCIe-Lanes, an denen dann SSDs, Zusatzcontroller etc. hängen, allerdings ergibt sich ein Flaschenhals, da dann über DMI mit der CPU kommuniziert werden muss.
[...]Der Chipsatz ist angeblich mit 4 CPU Lanes angesteuert, die natürlich von der CPU kommen müssen. Heisst das jetzt, die CPU hat in Wirklichkeit 20 Lanes (16+4) oder wird einfach aufgeteilt?[...]
Wenn du es so formulierst: Ja. 4 PCIe Lanes sind fest verdrahtet zum Chipsatz und werden deshalb nicht extra Aufgezählt. 16 sind 'frei' verfügbar und können auf PCIe Slot(s) für Grafikkarte(n) etc. gelegt werden.
@ Nilson
Damit könnte ich leben. 4 CPU Lanes fix über DMI mit dem Chipsatz verdrahtet, 16 für die Grafik, bzw. PCIe Steckplätze frei. Obwohl ich da auch gelesen haben, das diese abgezweigt werden können. Sicher bin ich mir immer noch nicht mit 16+4; dieses ganze Marketing blabla der Anbeiter ist echt nervig. Vielleicht hat jemand Kontakt zu Volker, der das mal korrekt bei Intel klären kann.
Die pcgameshardware erklärt zb, das auch vom graka pcie die Lanes zu anderen Geräten gesplittet werden. Die ganze Materie ist geschickt verkompliziert worden- wozu auch immer.
Da gibt's nichts weiter zu klären, beim Sockel 1151 hast du 16 PCIe-Lanes, die für die Grafikkartensteckplätze verwendet werden. Die Chipsatzverbindung läuft über DMI, was technisch eben 4 PCIe-Lanes sind, die aber nirgends separat erwähnt werden, weil für den Anwender eh nicht anderweitig nutzbar.
Würde ein M.2 an den CPU Leitungen hängen, kann man dies an der Hardware erkennen. denn es braucht dann Umschalter und diese kommen in Form von kleinen Chips daher.
@Nilson
Das mit der Verwendung nach dem Splitting ist mir schon klar. Der Fehler oder mein Fehler liegt darin, das ich 16 + 4= 16 nicht unbedingt logisch finde.
Aber trotzdem danke für die Anworten. Technisch ergibt 16+4 Sinn.
Warum es nicht so geschrieben wird, ist aber komisch.
Wenn das als 16+4 angegeben wäre, dann würden Leute wie du diese 4 Lanes suchen.
Außerdem sind diese 4 Lanes in den Schaubildern durchaus angegeben, nur eben unter der Bezeichnung DMI.
.. was dann eben keine 50% mehr Lanes bedeutet sondern nur 25%
WICHTIG für den Käufer sind eh meist nur die Lanes, die für Grafikkarten genutzt werden bzw. über den PCIe-Slot nutzbar sind. Denn genau hier findet diese Teilung von 1x16 zu 2x8 usw. statt. wurde hier aber auch mehrmals beschrieben.
die 4 Lanes des DMI bzw des Chipsatzes sind nicht "frei" nutzbar, sondern eben lediglich für die M2-Anschlüsse des Mainboards. Daher werden sie meist nicht in Verbindung mit PCIe genannt.
Wenn man eine M2-SSD via Adapter auf den PCIe-Slot nutzt (wie die Grafikkarte, dann erfolgt die genannte Teilung der PCIe-Lanes, wie sie auch bei mehreren genutzten Graifkkarten automatisch eingestellt werden.
Hm......es wird offenbar noch viel mehr geteilt, als ich angenommen habe- und eventuell muss die Graka während des Betriebs doch 8 CPU Lanes abgeben!
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Hier ein Beispiel mit dem Motherboard STRIX Z270F GAMING.
Dieses hat zwei Steckplätze für PCIe 3 mit 4 Lanes. Werden diese gleichzeitig abgefragt, ist damit der DMI 3.0 lt. Golem.de vollausgelastet! Wenn dann noch ein USB Steckplatz verwendet wird, muss entweder der Chipsatz teilen oder die Graka!
