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NewsThreadripper 2990X: Neues Ryzen-Flaggschiff für 1.500 Euro gelistet
Nein, keine milchmädchen Rechnung, sonst müsste an eben epyc betrachten. Wie kommt ihr eigentlich darauf immer wie es grade passt die Parameter zu verändern?
Aber schon consumer mit Server vergleichen will man sehen wie ich als Privat Person einen Rahmen vertrag bei Dell bekomme
Nein, keine milchmädchen Rechnung, sonst müsste an eben epyc betrachten. Wie kommt ihr eigentlich darauf immer wie es grade passt die Parameter zu verändern?
Aber schon consumer mit Server vergleichen
Bitte liess doch einfach die Posts, auf die du dich beziehst. Vergleiche zwischen den Hersteller wurden hier gar nicht gemacht. Ein User hatte die These aufgestellt, dass 2 Xeon 8180 (das sind nunmal Server-CPUs) eben mal 30.000€ kosten würde. Dem wurde widersprochen mit der Begründung, dass die Listenpreise in der Praxis nicht relevant sind und die Kunden entweder über eigene Verträge oder über einen IT-Hersteller wie Dell, HP usw. deutlich günstigere Preise erhalten können. Webshops geben diese meist nicht wieder.
Es ist halt sinnfrei, dass immer bei News zu Intel/AMD die jeweiligen Listenpreise verglichen werden und gesagt wird, Hersteller A sei x % teuerer und daraus Schlussfolgerungen für den Markt gezogen werden. Dabei ist das für den absoluten Großteil der Kunden und damit die Marktlage eben nicht der Fall. Egal ob nun Server- oder Workstationportfolio. Die Problematik gilt in beiden Bereichen. Der Selbstkäufer UND Selbstbauer ist bei Server- und Workstation-CPUs eine absolute Randgruppe. Die meisten CPUs werden über IT-Hersteller an die Kunden gebracht und wenn Intel größere Rabatte einräumt, dann hilft AMD am Ende der niedrigere Preis der Epyc auch nicht, denn bei beiden Produkten muss der Endpreis verglichen werden.
will man sehen wie ich als Privat Person einen Rahmen vertrag bei Dell bekomme
Es ist wie gesagt ein reiner Victim Cache. Da werden keine Daten aus dem RAM reingeladen. Das Design ist grundlegend anders als bei Intel. Die Wikipedia ist dazu ganz gut.
Cache Coheränz muss natürlich immer gewahrt sein. Das ist aber für Laien (inkl. mir) eine ziemlich komplizierte Geschichte. In kürze: Cache Lines können auch mit einem bit markiert werden wenn sie von anderen Core benutzt werden. Der Scheduler sollte eigentlich dafür sorgen das abhängige Threads nicht auf unterschiedlichen CCX liegen, das kann aber natürlich vorkommen. Dazu gibt es auch vom jeweiligen Hersteller gut gehütete vorhersage Algorithmen. Coheränz wird dann aber natürlich direkt über den IF wieder hergestellt, ähnlich wie bei MCM CPUs (e.g. Epyc/Threadripper).
Leider hab ich jetzt auf die schnelle kein Paper zum Ryzen gefunden, aber zum Shanghai (der eine zumindest ähnliche Cache Architektur hat) gibt es einen short Review den ich vor längerem mal gelesen habe. Wenn es Dich interessiert:
While the basic memory hierarchy structure is similar for Nehalem and Shanghai systems, the implementation details dier signicantly. Intel implements an inclusive last level cache in order to filter unnecessary snoop traffc.
Core valid bits within the L3 cache indicate that a cache line may be present in a certain core. If a bit is not set, the associated core certainly does not hold a copy of the cache line, thus reducing snoop traffc to that core. However, unmodied cache lines may be evicted from a core's cache without notication of the L3 cache. Therefore, a set core valid bit does not guarantee a cache line's presence in a higher level cache.
AMD's last level cache is non-inclusive [6], i.e neither exclusive nor inclusive. If a cache line is transferred from the L3 cache into the L1 of any core the line can be removed from the L3. According to AMD this happens if it is "likely" [3] (further details are undisclosed) that the line is only used by one core, otherwise a copy can be kept in the L3. Both processors use extended versions of the well-known MESI [7] protocol to ensure cache coherency. AMD Opteron processors implement the MOESI protocol [2, 5]. The additional state owned (O) allows to share modied data without a write-back to main memory. Nehalem processors implement
the MESIF protocol [9] and use the forward (F) state to ensure that shared unmodied data is forwarded only once.
Da es nicht öffentlich zugänglich ist hab ichs Dir mal über unseren Max-Planck Zugang gezogen und schick Dir gleich per PN einen Dropbox link.
Wie gehstn du ab?
Komm mal runter von deinem Hohen Ross.
Von 489 Posts wurde genau 35x genau wegen dieser einen Sache geschrieben, langsam sollte es wohl auch mal gut sein?
Macht die Sache nicht richtiger oder falscher wenn noch 10 Leute etwas darüber erzählen.
Der tenor war nämlich nochmal ein ganz anderer.
Der Stern von Netapp sinkt aber auch. Viel zu spät auf SSD-Caching ode reine SSD_Storage gesetzt und vieeel zu teuer. bei uns werden jetzt Hunderte von Netapps durch DELL VRTX (Kombi (VM-) Server, Switch, Storage) und im VM-Bereich durch SSD-Storages ersetzt (entweder einfach günstig oder professionell: Tintri)
Tintri insolvent ? Danke für den Hinweis - hoffentlich können Sie weiter machen - wir hatten alles Mögliche im Test, aber Tintri war mit Abstand die beste Lösung als ESX-Storage..
Das ist so, als würde im Porsche Magazin ein neuer MAN 40-Tonner beworben. Mit einem Unterschied, die wären wahrscheinlich nicht annähernd so euphorisch.....
Klar der Preis ist nicht so überzogen wie bei Intel aber rund 80% Aufpreis zum Vorgänger ist schon ne Ansage. Aber ja, wenn man die Kerne einsetzen kann ist der Preis eh eher nicht die Priorität.
Na ja 2950X hätte man auch 1955X nennen können. Das ist ja im Prinzip der gleiche Chip nur als Refresh, also kein "Nachfolger". Ein Nachfolger ist meiner Definition nach der bessere Chip der folgt bzw. der "größte" Chip.
Dann hätte der 7700k aber auch 2790k heißen müssen, weil das ja im Grunde nur ein Sandy Bridge refresh war.
Die Handhabung ist anders. Jede Veränderung am Chip bekommt eine neue große Nummer vorne und alles andere bleibt gleich, solang die Zielgruppe die gleiche ist.
will man sehen wie ich als Privat Person einen Rahmen vertrag bei Dell bekomme
